- 重点词汇
- Andabbr.Andorra 安道尔;Andaman Islands 安达曼群岛;Andromeda 安多米达（埃塞俄比亚公主）;Andalucía 安达卢西亚;
- RTL寄存器传输级；从右到左；保留时间锁定；寄存器级；卢森堡广播电视台
- typesn.类型;类型( type的名词复数 );铅字;（印刷或打印的）文字;于…类型的;
- objectn.物体;目标;宾语;（情感或反应的）对象 ;
- andconj. 和;与;而且;于是;然后
- AND与（计算机逻辑运算的一种，或称逻辑乘法） AND gate “与”门（电路，脉冲）;
- analysisn.分析，分解;梗概，要略;[数]解析;验定;
- rtlabbr.register transfer language 寄存器传送语言;reinforced tile lintel 加筋砖过梁;resistor-transistor logic 电阻-晶体管逻辑;
- classesn.班( class的名词复数 );等级;阶级;种类;
- 相关例句
delay test generation for processors combining rtl and gate level netlist
RTL和门级结合的处理器时延测试产生方法
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study on a high-level synthesis-based rtl synthesis object and its methods
基于高级综合的RTL综合对象及方法的研究
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in the logical design, an ip rtl description and function simulation are completed.
在逻辑设计中，完成了IP的RTL级的功能描述、功能仿真以及逻辑综合。
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the two algorithms generate tests for rtl circuits by test sets for modules.
这两个算法主要通过对电路按结构、功能划分为功能模块，然后利用功能模块的测试集进行RTL电路测试产生。
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warrants for rtl are analyzed in view of safety and traffic operation efficiency.
从安全和交通效率两个方面研究左转相位的设置。
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automatically extracting sequential information of integrate circuits based on rtl
自动提取RTL级集成电路时序信息
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the rtl design of the module is completed using verilog.
针对该芯片的架构，提出了缓冲器管理单元的设计方案，并应用Verilog语言完成了该单元的RTL级设计。
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realization of sequential logic synthesis in rtl synthesis system design
RTL综合系统设计中时序逻辑综合的实现方法
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sequential logic synthesis is an important part of rtl synthesis system design.
时序逻辑综合是RTL综合系统设计中的一个重要部分。
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