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This thesis describes the system design of a high-resolution pipelined ADC.
本文论述了高速高精度流水线结构模数转换器的设计.
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提出了一种16×16位的高速低功耗流水线乘法器的设计.
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The non pipelined approach is as follows: place a load of dirty clothes in the washer.
非流水线操作如以下所述: 把脏衣服放进洗衣机.
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PP - 流水线还可以降低流水线电路的时钟树功耗.
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A Pipelined AD Converter Based on Fully Differentiating Dual-tunnel Sampling/ Holding Circuit
一种全差分双通道采样保持的流水线操作AD变换器
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9、
本文研究了标准数字CMOS工艺下适于系统集成的低成本高速高精度流水线模数转换器（ADC）的实现。
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